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# Extended Page Tables (EPT)

アーキテクチャリファレンス: Feex

VT-x with EPTとも呼ばれます

EPT（Extended Page Tables）は、Intel仮想マシン向けにメモリ変換の第2段階を提供します。VT-x with EPTという表記は、仮想化とこの追加の変換機能の両方を指します。

## 確認しておくべき要点

EPT（Extended Page Tables）は、Intel仮想マシン向けにメモリ変換の第2段階を提供します。VT-x with EPTという表記は、仮想化とこの追加の変換機能の両方を指します。

## 仕組み

ゲストのページテーブルはゲスト仮想アドレスをゲスト物理アドレスへと変換し、EPTはハイパーバイザーの制御下でゲスト物理アドレスをホスト物理アドレスへと変換します。EPTエントリには独自のアクセス権があり、マッピングやアクセスが許可されていない場合はEPT違反を発生させることがあります。変換キャッシュと無効化ルールは正確性を維持するための重要な要素です。

## 有用な場面

ハイパーバイザーは、ゲストが独自の仮想アドレス空間を管理できるようにしながら、各VMのゲスト物理メモリを割り当てられたホストページにマッピングできます。これにより、従来のシャドウページテーブル技術への依存を低減できますが、実際のワークロードのコストは変換キャッシングやアクセスパターンに依然として依存します。

## サポートと有効化の確認方法

ハイパーバイザーまたは特権プラットフォームツールを使用して、VMX制御およびEPT機能情報を確認してください。VT-xのCPUIDビットだけでは不十分です。EPTを単一の汎用モードとして扱うのではなく、デプロイメントで必要とされる正確な制御とページサイズを検証してください。

仮想化された展開には複数のレイヤーが存在します。物理機能、ファームウェアの許可、アクティブなホストハイパーバイザー、公開されたゲスト機能、およびゲストOSのサポートです。関連する場合はネステッド仮想化を含め、操作が実際に実行されるレイヤーを確認してください。

## この機能が確立しない事項

EPTはVT-dではありません。CPU起因のゲストメモリ変換とデバイスのDMAリマッピングは異なる経路です。EPTのサポートは、あらゆるEPTページサイズ、実行制御拡張、またはネストされた仮想化構成を意味するものではありません。

## 実際の互換性とパフォーマンス

CPU実行、ゲストメモリ変換、およびデバイスDMA再マッピングは別々の機能です。単一の仮想化フィールドからパススルーや分離を推測しないでください。ハイパーバイザーのサポートされている診断機能と、正確なプラットフォーム/デバイス要件を使用してください。

## 実践的な検証チェックリスト

1. 関係する正確なプロセッサまたはプラットフォームのモデル、ならびにアプリケーション、OS、ランタイムのバージョンを記録してください。実際のエラーや要件の文言をそのまま保持してください。
2. その正確なモデルの製造元リファレンスを確認し、プログラムが実行される環境で実効的な機能と有効化状態を検査してください。
3. 選択したバイナリまたはバックエンドのすべての要件を比較してください。類似した名前の機能、エイリアス、または広範な技術表記だけでは不十分です。
4. アプリケーションが意図した実装を選択したことを確認してください。要件が満たされていない場合は、文書化された診断機能とサポートされているフォールバックを使用してください。
5. 一度に1つのサポート対象の変更のみを行い、同じワークロードを繰り返してください。元の構成と復旧手順を常に利用可能な状態にしておいてください。

## 機能が記載されているにもかかわらずソフトウェアで使用できない場合

正確にどのコンポーネントが失敗しているかから調査を開始してください。ハードウェアデータベースに記載されているのは記録された機能です。オペレーティングシステムまたはハイパーバイザーは、異なる実効環境を公開することがあります。破損や無関係な未サポート命令でも同様の症状が発生する可能性があるため、不正命令エラーの場合も実際にフォールトの原因となった命令とバイナリビルドの調査が必要です。

正確なプラットフォーム向けにサポートされているアプリケーション、ドライバ、またはランタイムのバージョンをインストールし、必要に応じてベンダーが文書化しているベースラインまたはフォールバックビルドを使用してください。ソフトウェアアップデートによってプロセッサに欠落している命令を作り出すことはできません。ファームウェアおよびセキュリティポリシーの変更は、一般的な最適化レシピではなく、システム製造元の手順と復旧計画に従う必要があります。

## 関連機能と有用な相違点

[VT-x](https://feex.it/wiki/l/ja/hardware/system/vt-x/) · [Second-Level Address Translation](https://feex.it/wiki/l/ja/hardware/system/slat/) · [NPTおよびRVI](https://feex.it/wiki/l/ja/hardware/system/npt-rvi/) · [VT-d](https://feex.it/wiki/l/ja/hardware/system/vt-d/) · [モードベース実行制御](https://feex.it/wiki/l/ja/hardware/system/mode-based-execute-control/)

## 本説明のソースと対象範囲

[Intel 64 and IA-32 Architectures Software Developer's Manual](https://www.intel.com/content/www/us/en/developer/articles/technical/intel-sdm.html)

これらのリファレンスは、アーキテクチャの動作およびソフトウェア要件を規定しています。リンクされたハードウェアモデルページのすべての機能値を個別に検証するものではありません。モデルのサポート状況については、そのページの製造元エビデンスを使用し、実際の実効システム構成を確認してください。この記事はベンチマーク、認定、または独立したレビュー日を提供するものではありません。

## 関連情報

これらはこの記事に関連する項目です。リンクごとに種別が表示されます。

[VT-x: アーキテクチャリファレンス](https://feex.it/wiki/l/ja/hardware/system/vt-x/)[Second-Level Address Translation: アーキテクチャリファレンス](https://feex.it/wiki/l/ja/hardware/system/slat/)[NPTおよびRVI: アーキテクチャリファレンス](https://feex.it/wiki/l/ja/hardware/system/npt-rvi/)[VT-d: アーキテクチャリファレンス](https://feex.it/wiki/l/ja/hardware/system/vt-d/)[モードベース実行制御: アーキテクチャリファレンス](https://feex.it/wiki/l/ja/hardware/system/mode-based-execute-control/)

## 出典と検証

エディトリアル所有権: Feex。独立したレビュー日は記録されていません。 [調査方法](https://feex.it/wiki/research/).

- [Intel 64 and IA-32 Architectures Software Developer's Manual ](https://www.intel.com/content/www/us/en/developer/articles/technical/intel-sdm.html)· 第1巻および第2巻では指定された命令ファミリおよびCPUIDについて説明し、第3巻では状態、ページング、VMX、保護制御について説明しています。アーキテクチャドキュメントは、特定のモデルに対するサポートを確定するものではありません。

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概要情報

このページの簡単な要約です。仕様、情報源、詳細な内容は記事本文に記載されています。

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Source: [Canonical Feex Wiki page](https://feex.it/wiki/l/ja/hardware/system/ept/)

[Developer guide](https://feex.it/wiki/developers/) | [API policy](https://feex.it/developers/api-policy/) | [Agent guidance](https://feex.it/wiki/llms.txt)